書き込み (FIFOメソッド)

インストールパッケージ: FPGAモジュール

FPGA FIFOに要素を書き込みます。 FIFOプロパティダイアログボックスのインタフェースページから書き込みごとの要素数を構成します。

このメソッドを実装するには、FIFOメソッドノードを使用します。

このメソッドで使用可能な入力と出力は、タイムアウトインタフェースを選択したかハンドシェイクインタフェースを選択したかによって異なります。

詳細  

FIFO入力はFIFOを指定します。 FIFO入力には、FIFO制御器FIFO定数VI定義FIFO構成ノード、またはその他のFIFOメソッドノードのFIFO出力端子を配線できます。
要素は、FIFOに保存するデータ要素または要素を指定します。 要素データタイプは、FIFOを作成した際にFIFOプロパティダイアログボックスで構成したデータタイプです。
タイムアウトは、FIFOが一杯の場合に、FIFOに空きスペースができるまでメソッドが待機する時間をクロックのティック数で指定します。 値を–1に設定すると、関数はタイムアウトしません。 0に設定すると、関数は待機しません。 FIFOメソッドノードをシングルサイクルタイミングループで使用する場合は、0の定数をタイムアウトに配線します。

この入力は、書き込みメソッドのデフォルトです。 この入力を表示するには、書き込みメソッドを右クリックし、ショートカットメニューでインタフェース→タイムアウトを選択します。
FIFO出力は、FIFO入力が配線されている場合、FIFO入力をそのまま返します。 配線されていない場合は、FIFO出力はFIFOメソッドノードで指定したFIFOを返します。
タイムアウト?は、関数が実行を完了するまでにFIFOの領域が利用可能にならない場合にTRUEを返します。 タイムアウト?がTRUEの場合、関数は要素をFIFOに書き込みません。
メモ  (Xilinx Vivado) シミュレーションモードでは、FIFOが組込制御論理で実装されている場合、このメソッドは、FIFO内の実際の要素数よりも少ない可能性がある、FIFOプロパティダイアログボックスの一般ページにある実際の要素数を使用するため、タイムアウト?の値がハードウェア上の実際の動作を反映しない可能性があります。
この出力は、書き込みメソッドのデフォルトです。 この出力を表示するには、書き込みメソッドを右クリックし、ショートカットメニューでインタフェース→タイムアウトを選択します。
入力有効は、次に処理するデータポイントの受信が完了したかどうかを示します。 先行ノードからこのノードにデータを渡すには、先行ノードの出力有効出力をこの入力に配線します。

このハンドシェイク端子を表示するには、シングルサイクルタイミングループ内の書き込みメソッドを右クリックし、ショートカットメニューからインタフェース→ハンドシェイクを選択します。
入力準備完了は、このノードが新しい入力データを受信できる状態になるとTRUEを返します。 この出力を先行ノードの出力準備完了入力に配線するには、フィードバックノードを使用します。

このハンドシェイク端子を表示するには、シングルサイクルタイミングループ内の書き込みメソッドを右クリックし、ショートカットメニューからインタフェース→ハンドシェイクを選択します。

書き込み (FIFOメソッド)の詳細

このメソッドをシングルサイクルタイミングループで使用する場合は、FIFOプロパティダイアログボックスのインタフェースページで書き込みオプションをリクエスタが複数の場合のみアービトレートまたはアービトレーションなしに設定する必要があります。 書き込みオプションをリクエスタが複数の場合のみアービトレートに設定した場合、複数のFIFOメソッドノードを書き込みメソッドと一緒に構成してFPGA VI内の同じFIFOにアクセスすることはできません。

シングルサイクルタイミングループ内でこのメソッドのタイムアウトインタフェースを有効にする場合、0の定数もタイムアウトに配線する必要があります。 書き込むデータがない場合、メソッドが実行され、有効なデータの代わりにタイムアウトが返されます。 データの書き込みが可能になるまで、メソッドはタイムアウトを返し続けます。

ハンドシェイクインタフェースを使用できるのは、シングルサイクルタイミングループ内のみです。 さらに、ピアツーピアとDMA FIFOには、ハンドシェイクインタフェースがサポートされていないターゲットもあります。 ハンドシェイクインタフェースがサポートされていないFIFOでは、コンパイル時エラーが返されます。

FIFOを使用して複数のクロック領域間でデータを転送することはできません。

関連情報

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